硬件描述語言（HDL）：高級(jí)程序設(shè)計(jì)語言，以文本形式來描述數(shù)字系統(tǒng)硬件結(jié)構(gòu)和行為的語言?？梢杂脕砻枋鲞壿嬰娐穲D、邏輯表達(dá)式、復(fù)雜數(shù)字邏輯系統(tǒng)的邏輯功能。IEEE推出兩種標(biāo)準(zhǔn)：VHDL和Verilog HDL。

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1、Verilog HDL和C語言的區(qū)別

Verilog HDL有Verilog-95版本（1995年成為IEEE的標(biāo)準(zhǔn)）和Verilog-2001版本，后者是Verilog HDL最主流的版本，具備一些新的實(shí)用功能：敏感列表、多維數(shù)組、生成語句塊、命名端口連接等。

Verilog HDL是硬件描述語言，編譯下載到FPGA后，會(huì)生成電路，因此Verilog HDL全部是并行處理與運(yùn)行的，處理速度很快，這也是FPGA大的優(yōu)勢(shì)。

C語言是軟件語言，下載到單片機(jī)后還是軟件指令，會(huì)生成硬件電路，單片機(jī)在處理軟件指令需要取址、譯碼、執(zhí)行，是串行執(zhí)行的。

2、Verilog HDL與VHDL的區(qū)別

兩者都是數(shù)字電路系統(tǒng)中常用的硬件描述語言。VHDL（美國軍方開發(fā)）早于Verilog HDL（公司開發(fā)）成為IEEE標(biāo)準(zhǔn)。

為什么選擇Verilog HDL？

Verilog HDL在系統(tǒng)級(jí)抽象方面比VHDL差一些，但在門級(jí)開關(guān)電路描述方面強(qiáng)于VHDL；且Verilog HDL和C語言類似，比VHDL更加直觀、簡單。

3、關(guān)于FPGA

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